[基于PLL信号发生器的设计论文资料] 此文档是基于PLL信号发生器的设计论文资料。 随着无线通信技术的应用和发展，对高质量的高频信号源要求日益迫切，这主要表现在对频率的稳定度和准确度的要求越来越高，并且希望能方便地调整频率。常见的信号产生方法很难满足这些要求，如石英晶体振荡器可以达到很高的频率稳定度，但是调整频率困难；LC振荡器调整频率比较容易，但是频率稳定度和精度方面又达不到要求。而锁相环频率合成技术则可以同时满足两方面的要求。
[用145152实现具有四模数] 此文档是用145152实现具有四模数。 对于MC 145152-2 常规的几种使用方法进行了总结I提出 了 一 种 用 MC 145152-2实现四模数分频器的 PLL的新方法L此方法采用两块 MC 145152-2和两块双模数前置分频器，由两块双模数前置分频器构成四个分频模式，因而称其为四模数方案。四模数分频器保证了PLL的分频系统连续变化。
[多参数可调扩频信号源的设计] 此文档是多参数可调扩频信号源的设计。 文档给出了一种利用 ARM LPC2104，锁相环 MC145151，压控振荡器 MC1648，CPLD 芯片EMP7128 和 FIFO IDT7205 等实现直接序列扩频（DSSS）信号源的设计方案。
[FIFO存储器的Verilog代码] 此项目是FIFO存储器的Verilog代码。在该项目中，提供了用于FIFO存储器的Verilog代码。 在Verilog中实现了具有以下规范的先进（FIFO）存储器：16个阶段、8位数据宽度、状态信号。Verilog测试平台用于调试和验证FIFO是否正确运行。 此外，有必要查看仿真波形和存储器以了解数据如何流动。想了解更多请下载附件。